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[讨论] 寄存器clk一直翻转,但D端为常值,功耗如何?

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发表于 2019-12-2 09:39:26 | 显示全部楼层 |阅读模式
如题,在做低功耗的时候,通常要将clk进行gating,减少clk翻转从而降低功耗。

但是如果寄存器clk一直翻转,但D端为常值,功耗相比直接关掉clk,有多大区别?
应该是没有太大的区别的吧
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发表于 2019-12-2 09:59:40 | 显示全部楼层

时钟走线。。。上面很多buff之类~~~~~
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发表于 2019-12-2 09:59:53 | 显示全部楼层
时钟树占比的功耗越来也高,所以也很可观
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发表于 2019-12-2 10:00:10 | 显示全部楼层
clock tree power is large than power in cell,if you use ptpx to analysis power,you will see clock power is more than 60 percent。
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发表于 2019-12-2 10:00:29 | 显示全部楼层
AC 应该是对LOAD电容的充放电的功耗,直接取决Clk的频率
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